840 resultados para Síntese peptídica


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Dissertação de mestrado, Ciências Farmacêuticas, Faculdade de Ciências e Tecnologia, Universidade do Algarve, 2015

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Dissertação de Mestrado, Ciências Farmacêuticas, Faculdade de Ciências e Tecnologia, Universidade do Algarve, 2015

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Dissertação de Mestrado, Ciências Biomédicas, 18 de Março de 2016, Universidade dos Açores.

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Trabalho Final de Mestrado para obtenção do grau de Mestre em Engenharia Química e Biológica

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Trabalho Final de Mestrado para obtenção do grau de Mestre em Engenharia Química e Biológica Ramo de Processos Químicos

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Trabalho Final de Mestrado para obtenção do Grau de Mestre em Engenharia Química e Biológica

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Trabalho Final de Mestrado para obtenção do grau de Mestre em Engenharia Química e Biológica

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En primer lugar, se exponen los distintos tipos de tecnologías del habla existente y su importancia para lograr la integración del mundo tecnológico en la sociedad de la información. Después, se realiza una descripción del primer sintetizador de voz en lengua gallega, 'Cotovía'. Es un conversor texto-voz basado en la técnica de concatenación de unidades. Como conclusión final, se deduce que las lenguas que no consigan desenvolverse mínimamente en este ámbito, tendrán serias dificultades para seguir subsistiendo.

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Este trabalho apresenta uma metodologia para a geração automática de ASICs, em VHDL, a partir da linguagem de entrada Java. Como linguagem de especificação adotou-se a Linguagem Java por esta possuir características desejáveis para especificação a nível de sistema, como: orientação a objetos, portabilidade e segurança. O sistema é especificamente projetado para suportar síntese de ASICs a partir dos modelos de computação Máquina de Estados Finita e Pipeline. Neste trabalho, adotou-se estes modelos de computação por serem mais usados em sistemas embarcados As principais características exploradas são a disponibilização da geração de ASICs para a ferramenta SASHIMI, o alto nível de abstração com que o projetista pode contar em seu projeto, as otimizações de escalonamento realizadas automaticamente, e o sistema ser capaz de abstrair diferentes modelos de computação para uma descrição em VHDL. Portanto, o ambiente permite a redução do tempo de projeto e, consequentemente, dos custos agregados, diminuindo a probabilidade de erros na elaboração do projeto, portabilidade e reuso de código – através da orientação a objetos de Java – podendo-se proteger os investimentos prévios em desenvolvimento de software. A validação desses conceitos foi realizada mediante estudos de casos, utilizando-se algumas aplicações e analisando os resultados obtidos com a geração dos ASICs.