101 resultados para Síntese de sistemas digitais
em Repositório Institucional UNESP - Universidade Estadual Paulista "Julio de Mesquita Filho"
Resumo:
Conselho Nacional de Desenvolvimento Científico e Tecnológico (CNPq)
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Given a linear time-invariant plant Gol(s) with one input and q outputs, where q > 1, a method based on the Routh-Hurwitz Stability Criterion is proposed to obtain a constant tandem matrix F ∈ ℝq, such that FGOl(s) is a minimumphase system. From this solution, the system FGol(s) is represented in state space by {A, B, FC} and a constant output feedback matrix K0 ∈ ℝ is obtained such that the feedback system {A - BK0C, B, FC} is Strictly Positive Real (SPR). The proposed procedure offers necessary and sufficient conditions for both problems. Initially, the general case, with a generic q, is analyzed. Following, the particular cases q = 2 and q = 3 are studied.
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Pós-graduação em Geografia - IGCE
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Pós-graduação em Ciência da Computação - IBILCE
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Coordenação de Aperfeiçoamento de Pessoal de Nível Superior (CAPES)
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Coordenação de Aperfeiçoamento de Pessoal de Nível Superior (CAPES)
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Pós-graduação em Engenharia Elétrica - FEIS
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Coordenação de Aperfeiçoamento de Pessoal de Nível Superior (CAPES)
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Uma arquitetura reconfigurável e multiprocessada para a implementação física de Redes de Petri foi desenvolvida em VHDL e mapeada sobre um FPGA. Convencionalmente, as Redes de Petri são transformadas em uma linguagem de descrição de hardware no nível de transferências entre registradores e um processo de síntese de alto nível é utilizado para gerar as funções booleanas e tabelas de transição de estado para que se possa, finalmente, mapeá-las num FPGA (Morris et al., 2000) (Soto and Pereira, 2001). A arquitetura proposta possui blocos lógicos reconfiguráveis desenvolvidos exclusivamente para a implementação dos lugares e das transições da rede, não sendo necessária a descrição da rede em níveis de abstração intermediários e nem a utilização de um processo de síntese para realizar o mapeamento da rede na arquitetura. A arquitetura permite o mapeamento de modelos de Redes de Petri com diferenciação entre as marcas e associação de tempo no disparo das transições, sendo composta por um arranjo de processadores reconfiguráveis, cada um dos quais representando o comportamento de uma transição da Rede de Petri a ser mapeada e por um sistema de comunicação, implementado por um conjunto de roteadores que são capazes de enviar pacotes de dados de um processador reconfigurável a outro. A arquitetura proposta foi validada num FPGA de 10.570 elementos lógicos com uma topologia que permitiu a implementação de Redes de Petri de até 9 transições e 36 lugares, atingindo uma latência de 15,4ns e uma vazão de até 17,12GB/s com uma freqüência de operação de 64,58MHz.
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Pós-graduação em Ciências Cartográficas - FCT
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Conselho Nacional de Desenvolvimento Científico e Tecnológico (CNPq)
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Coordenação de Aperfeiçoamento de Pessoal de Nível Superior (CAPES)
Desenvolvimento de uma arquitetura reconfigurável para o processamento de modelos no ambiente ABACUS
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Conselho Nacional de Desenvolvimento Científico e Tecnológico (CNPq)
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Conselho Nacional de Desenvolvimento Científico e Tecnológico (CNPq)
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Pós-graduação em Física - IGCE