3 resultados para ONLY-MEMORY DISC

em Cor-Ciencia - Acuerdo de Bibliotecas Universitarias de Córdoba (ABUC), Argentina


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El objetivo de este proyecto es investigar el sustrato neurobiológico que subyace a los efectos centrales de grelina (Gr) en estructuras extrahipotalámicas tales como núcleo dorsal del rafe (NDR), hipocampo(Hi) y amígdala(Am) donde hemos demostrado que el péptido incrementa la memoria e ingesta, Los mecanismos neurales, neurotrasmisores(nt), segundos mensajeros, etc., involucrados en estos procesos fisiológicos, inducidos por el péptido, necesitan aun ser esclarecidos. Hemos demostrado que grelina incrementa la retención de la memoria cuando es inyectado en Hi, NDR y Am. También incrementa la ingesta al ser administrado en Hi y NDR pero no así en Am. En Hi los efectos de Gr sobre la memoria se correlacionan con incremento en los niveles tisulares de óxido nítrico (NO) y con la disponibilidad del nt 5-HT. En lo que a electrofisiología se refiere hemos demostrado que Gr disminuye el umbral para generar potenciación a largo plazo (LTP). A fin de aportar nuevas evidencias que contribuyan a esclarecer los efectos del péptido sobre memoria e ingesta utilizaremos estudios conductuales, determinaciones bioquímicas y determinaciones electrofisiológicas. En lo que a ingesta se refiere intentaremos esclarecer el papel de los núcleos central y basolateral de la Am en aspectos hedónicos de la ingesta inducida por Gr En esta etapa, más específicamente nos proponemos:1) Determinar si los efectos de grelina sobre ingesta y memoria demostrados en hipocampo y NDR después de la su administración se correlacionan con modificaciones en la liberación de serotonina utilizando cortes de hipocampo precargados con 5HT tritiada en presencia y ausencia del péptido.2) Evaluar si el incremento de óxido nítrico inducido por grelina en hipocampo se correlaciona con cambios en la expresión de nNOS, utilizando Western-blot y la importancia de NOS/NO en la acción de grelina repitiendo los experimentos previo tratamiento de las ratas con inhibidores de NOS. 3)Estudiar la participación del nt glutamato en los efectos hipocampales de Gr sobre la memoria. Analizando a) si grelina modifica la liberación del nt a partir de sinaptosomas aislados de hipocampo de ratas pretratadas con Gr.b) la participación de los receptores NMDA y GABAa en los efectos de grelina previo bloqueo farmacológico del mencionado receptor y el test step down.c) la participación de los receptores NMDA y GABAa en los efectos de grelina utilizando electrofisiología y Western Blot. 4) Estudiar el efecto de la administración de Gr en Amigdala Central y Basolateral sobre aspectos hedónicos de la ingesta utilizando diferentes paradigmas conductuales en animales. Estudiaremos:a) si Gr modifica el consumo de alimento de diferente palatabilidad en animales y si afecta el componente motivacional de la conducta de ingesta paradigma de "runway".

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En el marco de la recuperación de la memoria en relación con los hechos de la última dictadura militar es importante determinar los motivos ideológico-teológicos y prácticos que dificultaron una oposición significativa por parte de la jerarquía de la iglesia a la violación de los derechos humanos, e individualizar los argumentos que impulsaron un discurso y una praxis de reconciliación que privilegió el olvido de las víctimas y apoyó acríticamente los «proyectos de olvido», como la ley de punto final, entre otros. Para analizar dichos discursos y praxis se recurre principalmente a Johann Metz, quien, vinculado a la Escuela de Frankfurt, propone una razón anamnética del sufrimiento ajeno. La originalidad del proyecto es doble, por su contenido y por su enfoque: la confrontación del «servicio de reconciliación» eclesial con la «memoria de las víctimas». Hipótesis de trabajo: el discurso y la praxis eclesial en relación al «servicio de reconciliación» realizado por el Episcopado argentino a partir de 1981, pone de manifiesto: primero, que siguieron vinculados a la idea de "nación católica" (Zanatta 1996, Dri 1997, Esquivel 2004), lo que dificultó, junto a otros factores, la visibilización de las víctimas; segundo, a su vez, analizados a la luz de los aportes filosófico-teológicos mencionados, muestran una notable carencia en la valoración de la memoria de las víctimas, esperable en una reconciliación. Objetivo general: realizar un análisis crítico de los discursos y prácticas institucionales oficiales de la Iglesia católica en Argentina en relación con la memoria de las víctimas de la última dictadura militar. Objetivos específicos: confrontar las experiencias eclesiales argentinas recientes, y sus conceptualizaciones y tipos de argumentación, con una tradición de pensamiento que en relación al acontecimiento del Holocausto sitúa en el centro de la reflexión temas como el de la memoria, el sufrimiento de las víctimas, y un modo peculiar de tratamiento de los hechos históricos; además, individualizar y analizar los argumentos que dificultaron la búsqueda de la justicia y la memoria de las víctimas. Metodología y etapas. 1° Etapa: analizar y sistematizar algunos aspectos de las teorías del conocimiento histórico y de la razón comunicativa en determinadas obras de Benjamin, Bloch y Habermas; posteriormente, precisar la apropiación conceptual de las categorías histórico-filosóficas de dichas corrientes llevada a cabo por Metz para elaborar su «memoria de las víctimas». 2° Etapa: revisar el discurso y la praxis eclesial a partir de 1981 a la luz del marco teórico ya estudiado. Será necesario, por una parte, detenerse en las declaraciones eclesiales oficiales referidas al retorno de la democracia, a las leyes de punto final y obediencia debida, como así también, en el reconocimiento y pedido de perdón por las culpas del pasado.

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El avance en la potencia de cómputo en nuestros días viene dado por la paralelización del procesamiento, dadas las características que disponen las nuevas arquitecturas de hardware. Utilizar convenientemente este hardware impacta en la aceleración de los algoritmos en ejecución (programas). Sin embargo, convertir de forma adecuada el algoritmo en su forma paralela es complejo, y a su vez, esta forma, es específica para cada tipo de hardware paralelo. En la actualidad los procesadores de uso general más comunes son los multicore, procesadores paralelos, también denominados Symmetric Multi-Processors (SMP). Hoy en día es difícil hallar un procesador para computadoras de escritorio que no tengan algún tipo de paralelismo del caracterizado por los SMP, siendo la tendencia de desarrollo, que cada día nos encontremos con procesadores con mayor numero de cores disponibles. Por otro lado, los dispositivos de procesamiento de video (Graphics Processor Units - GPU), a su vez, han ido desarrollando su potencia de cómputo por medio de disponer de múltiples unidades de procesamiento dentro de su composición electrónica, a tal punto que en la actualidad no es difícil encontrar placas de GPU con capacidad de 200 a 400 hilos de procesamiento paralelo. Estos procesadores son muy veloces y específicos para la tarea que fueron desarrollados, principalmente el procesamiento de video. Sin embargo, como este tipo de procesadores tiene muchos puntos en común con el procesamiento científico, estos dispositivos han ido reorientándose con el nombre de General Processing Graphics Processor Unit (GPGPU). A diferencia de los procesadores SMP señalados anteriormente, las GPGPU no son de propósito general y tienen sus complicaciones para uso general debido al límite en la cantidad de memoria que cada placa puede disponer y al tipo de procesamiento paralelo que debe realizar para poder ser productiva su utilización. Los dispositivos de lógica programable, FPGA, son dispositivos capaces de realizar grandes cantidades de operaciones en paralelo, por lo que pueden ser usados para la implementación de algoritmos específicos, aprovechando el paralelismo que estas ofrecen. Su inconveniente viene derivado de la complejidad para la programación y el testing del algoritmo instanciado en el dispositivo. Ante esta diversidad de procesadores paralelos, el objetivo de nuestro trabajo está enfocado en analizar las características especificas que cada uno de estos tienen, y su impacto en la estructura de los algoritmos para que su utilización pueda obtener rendimientos de procesamiento acordes al número de recursos utilizados y combinarlos de forma tal que su complementación sea benéfica. Específicamente, partiendo desde las características del hardware, determinar las propiedades que el algoritmo paralelo debe tener para poder ser acelerado. Las características de los algoritmos paralelos determinará a su vez cuál de estos nuevos tipos de hardware son los mas adecuados para su instanciación. En particular serán tenidos en cuenta el nivel de dependencia de datos, la necesidad de realizar sincronizaciones durante el procesamiento paralelo, el tamaño de datos a procesar y la complejidad de la programación paralela en cada tipo de hardware. Today´s advances in high-performance computing are driven by parallel processing capabilities of available hardware architectures. These architectures enable the acceleration of algorithms when thes ealgorithms are properly parallelized and exploit the specific processing power of the underneath architecture. Most current processors are targeted for general pruposes and integrate several processor cores on a single chip, resulting in what is known as a Symmetric Multiprocessing (SMP) unit. Nowadays even desktop computers make use of multicore processors. Meanwhile, the industry trend is to increase the number of integrated rocessor cores as technology matures. On the other hand, Graphics Processor Units (GPU), originally designed to handle only video processing, have emerged as interesting alternatives to implement algorithm acceleration. Current available GPUs are able to implement from 200 to 400 threads for parallel processing. Scientific computing can be implemented in these hardware thanks to the programability of new GPUs that have been denoted as General Processing Graphics Processor Units (GPGPU).However, GPGPU offer little memory with respect to that available for general-prupose processors; thus, the implementation of algorithms need to be addressed carefully. Finally, Field Programmable Gate Arrays (FPGA) are programmable devices which can implement hardware logic with low latency, high parallelism and deep pipelines. Thes devices can be used to implement specific algorithms that need to run at very high speeds. However, their programmability is harder that software approaches and debugging is typically time-consuming. In this context where several alternatives for speeding up algorithms are available, our work aims at determining the main features of thes architectures and developing the required know-how to accelerate algorithm execution on them. We look at identifying those algorithms that may fit better on a given architecture as well as compleme