3 resultados para Speed detectors.

em Repositório Institucional da Universidade de Aveiro - Portugal


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A Micro-Hole & Strip Plate (MHSP) é uma microestrutura desenvolvida recentemente em instituições universitárias portuguesas. Neste trabalho, o seu desempenho como detector para imagiologia é explorado, tendo como objectivo a imagiologia não só de neutrões, mas também de raios X. A aplicação do método da divisão resistiva de carga é aplicada a uma MHSP especialmente desenhada para sensibilidade em posição. Várias abordagens em termos da electrónica de aquisição de sinal são testadas, sem perder de vista a relação desempenho-preço. Resoluções espaciais abaixo de 1 mm foram obtidas com a MHSP a operar em xénon e tetrafluorometano, com um sistema de detecção a um preço modesto quando comparado com as alternativas, e apropriado para inúmeras aplicações em imagiologia de neutrões e de raios X.

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This work presents the results on the development of a high pressure Xe gaseous detector envisaging medical imaging. The detector uses two VUV photosensors operating face-to-face, based on the CsI-MHSP with position discrimination capability. The known effect of the charge gain decrease with the gas pressure is compensated with a light gain using the electroluminescence process. Studies of signal amplitude, energy and position resolution are presented. On the second part, gaseous detectors based on THGEM where studied in order to fulfill the requirements of present and future high energy physics experiments. The work is focused on the application of THGEM in RICH detectors elements: a triple THGEM detector using CsI photocathodes in Ne mixtures was suggested. The ion backflow to the photocathode remains a concern and a limitation; to minimize it, the application of a new hole-structure, THCOBRA, was suggested. Preliminary results foresee good perspectives for the successful application of THCOBRA in ion back-flow suppression. This work contains several methods and measurements of the CsI photocathodes behaviour in radiation gaseous detectors. A long discussion on its issues and possible solutions are presented.

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A integridade do sinal em sistemas digitais interligados de alta velocidade, e avaliada através da simulação de modelos físicos (de nível de transístor) é custosa de ponto vista computacional (por exemplo, em tempo de execução de CPU e armazenamento de memória), e exige a disponibilização de detalhes físicos da estrutura interna do dispositivo. Esse cenário aumenta o interesse pela alternativa de modelação comportamental que descreve as características de operação do equipamento a partir da observação dos sinais eléctrico de entrada/saída (E/S). Os interfaces de E/S em chips de memória, que mais contribuem em carga computacional, desempenham funções complexas e incluem, por isso, um elevado número de pinos. Particularmente, os buffers de saída são obrigados a distorcer os sinais devido à sua dinâmica e não linearidade. Portanto, constituem o ponto crítico nos de circuitos integrados (CI) para a garantia da transmissão confiável em comunicações digitais de alta velocidade. Neste trabalho de doutoramento, os efeitos dinâmicos não-lineares anteriormente negligenciados do buffer de saída são estudados e modulados de forma eficiente para reduzir a complexidade da modelação do tipo caixa-negra paramétrica, melhorando assim o modelo standard IBIS. Isto é conseguido seguindo a abordagem semi-física que combina as características de formulação do modelo caixa-negra, a análise dos sinais eléctricos observados na E/S e propriedades na estrutura física do buffer em condições de operação práticas. Esta abordagem leva a um processo de construção do modelo comportamental fisicamente inspirado que supera os problemas das abordagens anteriores, optimizando os recursos utilizados em diferentes etapas de geração do modelo (ou seja, caracterização, formulação, extracção e implementação) para simular o comportamento dinâmico não-linear do buffer. Em consequência, contributo mais significativo desta tese é o desenvolvimento de um novo modelo comportamental analógico de duas portas adequado à simulação em overclocking que reveste de um particular interesse nas mais recentes usos de interfaces de E/S para memória de elevadas taxas de transmissão. A eficácia e a precisão dos modelos comportamentais desenvolvidos e implementados são qualitativa e quantitativamente avaliados comparando os resultados numéricos de extracção das suas funções e de simulação transitória com o correspondente modelo de referência do estado-da-arte, IBIS.