Sviluppo di un modulo VHDL per interfacciamento Ethernet-FPGA in applicazioni di high throughput screening


Autoria(s): Renzi, Alessandro
Contribuinte(s)

Romani, Aldo

Data(s)

26/07/2012

Resumo

In molti settori della ricerca in campo biologico e biomedico si fa ricorso a tecniche di High Throughput Screening (HTS), tra cui studio dei canali ionici. In questo campo si studia la conduzione di ioni attraverso una membrana cellulare durante fenomeni che durano solo alcuni millisecondi. Allo scopo sono solitamente usati sensori e convertitori A/D ad elevata velocità insieme ad opportune interfacce di comunicazione, ad elevato bit-rate e latenza ridotta. In questa tesi viene descritta l'implementazione di un modulo VHDL per la trasmissione di dati digitali provenienti da un sistema HTS attraverso un controller di rete integrato dotato di un'interfaccia di tipo Ethernet, individuando le possibili ottimizzazioni specifiche per l'applicazione di interesse.

Formato

application/pdf

Identificador

http://amslaurea.unibo.it/4042/1/renzi_alessandro_tesi.pdf

Renzi, Alessandro (2012) Sviluppo di un modulo VHDL per interfacciamento Ethernet-FPGA in applicazioni di high throughput screening. [Laurea], Università di Bologna, Corso di Studio in Ingegneria elettronica, informatica e telecomunicazioni [L-DM270] - Cesena <http://amslaurea.unibo.it/view/cds/CDS8196/>

Relação

http://amslaurea.unibo.it/4042/

Direitos

info:eu-repo/semantics/openAccess

Palavras-Chave #VHDL, FPGA, Ethernet, High Throughput Screening #scuola :: 843884 :: Ingegneria e Architettura #cds :: 8196 :: Ingegneria elettronica, informatica e telecomunicazioni [L-DM270] - Cesena #sessione :: prima
Tipo

PeerReviewed